चित्र:CMOS NAND Layout.svg

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सारांश

विवरण
English: The physical layout of a CMOS NAND circuit. The larger regions of N-type diffusion and P-type diffusion are part of the transistors. The two smaller regions on the left are taps to prevent latchup.
עברית: שער לוגי מסוג NAND ממבט על.
Polski: budowa bramki NAND CMOS.
Română: Aranjamentul fizic al unei porţi NAND CMOS.
中文：CMOS与非门的布图.
CMOS NAND Layout for chip
दिनांक ७ सितम्बर २००६ (original upload date)
स्रोत Transferred from en.wikipedia to Commons.
लेखक अंग्रेज़ी विकिपीडिया पर Jamesm76
दूसरे संस्करण Derivative works of this file:  CMOS AND Silicon.svg

लाइसेंस

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मूल अपलोड लॉग

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  • 2006-09-07 23:46 Jamesm76 294×587×0 (11839 bytes) I am the author and I release this to the public domain.
  • 2006-09-07 23:27 Jamesm76 294×587×0 (11827 bytes) SVG drawing of a CMOS NAND gate replacing the older PNG version I had previously uploaded ("CMOS NAND Layout.png"). I am the author and I release this to the public domain.

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Schematic of CMOS NAND circuit layout

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checksum अंग्रेज़ी

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निर्धारण विधि: SHA-1 अंग्रेज़ी

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११,८३९ बाइट

ऊँचाई

५८७ पिक्सल

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२९४ पिक्सल

चित्र का इतिहास

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दिनांक/समयथंबनेलआकारसदस्यप्रतिक्रिया
वर्तमान20:46, 19 अक्टूबर 200720:46, 19 अक्टूबर 2007 के संस्करण का थंबनेल संस्करण294 × 587 (12 KB)Prolineserver{{Information |Description=''no original description'' |Source=Originally from [http://en.wikipedia.org en.wikipedia]; description page is/was [http://en.wikipedia.org/w/index.php?title=Image%3ACMOS_NAND_Layout.svg here]. |Date=2006-09-07 (first version);

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